No processo de PCB projeto, porque a segmentação de plano, pode levar a um plano de referência de sinal descontínuo, para sinal de baixa frequência, pode não ter nada a ver, nos sistemas digitais de alta frequência, sinal de alta frequência para o plano de referência para caminho de retorno, ou seja, o caminho de fluxo , se a descontinuidade de superfície de referência ᒣ sinalizar através da ruptura, isso trará muitos problemas, Como EMI, crosstalk e outros problemas. Nesse caso, a segmentação precisa ser costurada para fornecer um caminho de refluxo mais curto para o sinal. Os métodos de processamento comuns incluem a adição de capacitância de costura e ponte:

A. Capacitor Stiching˖

Normalmente, um capacitor de cerâmica 0402 ou 0603 é colocado na divisão do sinal e a capacitância do capacitor é 0.01uF ou 0.1uF. Se o espaço permitir, vários outros capacitores semelhantes ˗ podem ser adicionados. Enquanto isso, tente garantir que a linha de sinal esteja dentro da capacitância de costura de 200mil. Quanto menor a distância, melhor ˗ e as redes em ambas as extremidades do capacitor correspondem às redes do plano de referência por onde passa o sinal. Veja as redes conectadas em ambas as extremidades do capacitor na Figura 1, e as duas redes diferentes destacadas em duas cores:

Como fazer uma placa PCB estável

B. Ponte sobre ˖

Comum é o “processamento de terra de pacote de sinal” na camada de sinal em toda a segmentação, também pode ser o pacote de outras linhas de sinal de rede, este “terra de pacote” tão espesso quanto possível, este método de processamento, consulte a figura a seguir

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Aqui está uma descrição suplementar da geração comum de segmentação cruzada ˖

1. A seguinte segmentação ˖ em uma única placa, pode haver um monte de fontes de alimentação para processar, e o número de fontes de alimentação sob o número limitado; Após uma consideração abrangente, tivemos que operar no plano de potência. Às vezes, pode ser um corte limpo e claro – e às vezes não pode evitar uma conexão prolongada e pode sacrificar apenas um sinal menos crítico, mas deve ser corrigido. Essa sensação é como andar para casa, de repente cavar uma vala, isso é um problema, em volta disso, um pouco longe, pode ser perseguido pelo cachorro de alguém; Bem,

Basta construir uma ponte ou você pode ir para casa.

Então, além da metáfora selvagem, se você fizer uma partição em um PCB, então

Verifique a linha de sinal ou algo pode acontecer.

2. A situação acima não é fácil de ignorar e há outra situação que pode ser negligenciada. Se o VIA for muito denso, levando ao corte do plano, afinal, a outra via também é ocupada pelo espaço, mais dará o seguinte para ocupar, resultando em ‘corte, essa situação não é descrita aqui, o relevante introdução é mais. Nesse caso, você precisa definir boas regras no estágio inicial e verificá-las cuidadosamente no estágio posterior.

Clock, reset, sinais acima de 100M e alguns sinais de bus principal não podem ser separados. Existe pelo menos um plano completo, de preferência o plano GND.

O sinal do relógio, o sinal de alta velocidade e o sinal sensível proíbem a segmentação cruzada;

Os sinais diferenciais devem ser equilibrados com o solo para evitar a segmentação do span de linha única. (Segmentação cruzada vertical, tanto quanto possível)

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O caminho de retorno de alta frequência de todos os sinais está localizado diretamente abaixo da linha de sinal da camada adjacente. A integridade do sinal e os problemas de tempo podem ser significativamente reduzidos colocando uma camada sólida sob o sinal que fornece um loop direto para o sinal. Um capacitor de circuito de 0.01uF deve ser usado quando a separação e o cruzamento entre a fiação e a camada forem inevitáveis. Quando os capacitores de loop são usados, eles devem ser colocados o mais próximo possível da interseção da linha de sinal e da partição da camada.